【基于zynq的卷积神经网络加速器设计】（一）熟悉vivado和fpga开发流程：使用Vivado硬件调试烧写hello-world led闪烁程序实现及vivado软件仿真_zynq加速神经网络-程序员宅基地

技术标签： 卷积神经网络  vivado  fpga  IC  zynq  加速器  

HIGHLIGHT:

  • vivado设计流程：
    在这里插入图片描述
    note：
    分析与综合 和 约束输入 可以调换顺序

【基于zynq的卷积神经网络加速器设计】（一）熟悉vivado和fpga开发流程：使用Vivado硬件调试烧写hello-world led闪烁程序实现及vivado软件仿真

一、硬件调试

（一）新建工程

  1. new project
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  2. next
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  3. 编辑，然后next
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  4. 勾选创建完工程再添加文件
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  5. 根据实际情况选择型号
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  6. finish
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（二）设计输入

  1. add source
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  2. create design source
  3. create file
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  4. 命名（一般顶层模块名和工程名保持一致）、ok
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  5. finish
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  6. 端口信号不做定义，点击ok
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  7. 双击创建的.V文件，然后在代码编辑区域输入代码
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（三）分析

  1. open elaborated design
    verilog转换rtl
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（四）约束输入

  1. io planing
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  2. 选择管脚和管脚电平
    自行在自己开发板对应的原理图手册查找
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  3. 按下ctri+s——>起名——>ok
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  4. 右键关闭
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  5. 打开xdc文件
    这个文件可以做IO约束 或者 时序约束
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note：
约束这里可以自己添加约束文件
在这里插入图片描述
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（五）综合、实现、生成比特流

  1. 点击generate bitstream
    点击generate bitstream后，vivado会自动跑综合和实现。提示框点击yes即可
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  2. 选择跑的时候运行的处理器核心数
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  3. 可以点击project summary查看进度
    图中在综合
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  4. 跑完了后会弹出以下框框
    选择选项3再按ok，或者直接按左边的按钮open hardware manager
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  5. 开发板上电连接电脑后选择program device 或者 左下角按钮
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  6. 点击program
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  7. 验证成功

二、软件仿真

（一）步骤

  1. 右键添加
    创建激励文件（testbench文件）
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  2. next
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  3. 编辑名字
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  4. finish
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  5. ok
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  6. 双击testbench文件，把自动生成的注释删去
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  7. 根据自己需求功能编写信号激励
    这里主要是时钟和复位信号
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  8. 点击行为仿真
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结果：
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9. 点击所例化的文件，将cnt信号拖入信号栏
在这里插入图片描述
自行查看结果即可

（二）仿真界面指导

  1. 按钮指导：
    在这里插入图片描述

  2. 设置仿真时间
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    这里默认打开后仿真1000ns，可以在这里修改
    在这里插入图片描述

  3. 默认为显示十六进制，可以更改为十进制
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  4. 查看时钟周期
    间隔的两个上升沿分别add marker
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    单击左边蓝线，可见间隔为20ns，符合代码
    在这里插入图片描述

  5. 注意的是
    代码定义的计数器的值太大，这里只仿真1000ns，如果要跑仿真实际结果，需要很长时间，所以要么就等待，要么就修改计数器的值来模拟即可。

改完代码直接保存，并且relunch即可
在这里插入图片描述

  1. 保存波形文件
    ctrl+s 保存即可
    在这里插入图片描述
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